คอลเลกชั่นผลิตภัณฑ์
เอฟพีจีเอ Stratix® V GS
สถานะ
Launched
วันที่วางจำหน่าย
2010
การทำลวดลายวงจร
28 nm

แหล่งข้อมูล

Logic Element (LE)
695000
อะแดปทีฟ ลอจิก โมดูล (ALM)
262400
รีจีสเตอร์ อะแดปทีฟ ลอจิก โมดูล (ALM)
1049600
เฟสล็อกลูปเนื้อผ้าและ I/O (PLL)
28
หน่วยความจำแบบฝังสูงสุด
58.01 Mb
การประมวลผลสัญญาณดิจิทัล (DSP)
1963
รูปแบบการประมวลผลสัญญาณดิจิทัล (DSP)
Multiply and Accumulate, Variable Precision, Fixed Point (hard IP)
คอนโทรลเลอร์หน่วยความจำแบบแข็ง
ไม่ใช่
อินเทอร์เฟซหน่วยความจำภายนอก (EMIF)
DDR3, DDR2, DDR, QDR II, QDR II+, RLDRAM II, RLDRAM 3

ข้อมูลจำเพาะ I/O

จำนวน I/O ผู้ใช้สูงสุด
840
การรองรับมาตรฐาน I/O
3.0 V LVTTL, 1.2 V to 3.0 V LVCMOS, SSTL, HSTL, HSUL, Differential SSTL, Differential HSTL, Differential HSUL, LVDS, Mini-LVDS, RSDS, LVPECL, BLVDS
คู่ LVDS สูงสุด
420
ตัวรับส่งสัญญาณแบบไม่กลับสู่ศูนย์ (NRZ) สูงสุด
48
อัตราข้อมูลแบบไม่กลับสู่ศูนย์ (NRZ) สูงสุด
14.1 Gbps
โปรโตคอลตัวรับส่งสัญญาณ Hard IP
PCIe Gen3

ข้อมูลจำเพาะของแพ็คเกจ

ตัวเลือกของแพ็คเกจ
F1517, F1932

ข้อมูลเสริม

URL ข้อมูลเพิ่มเติม