"Pin Information for the Stratix® III EP3SL340 Device Version 1.1 " Bank Number VREF Pin Name/Function Optional Function(s) Configuration Function Dedicated Tx/Rx Channel Emulated LVDS Output Channel F1760 F1517 H1152 DQS for X4 for F1760 DQS for X8/X9 for F1760 (Note 1) DQS for X16/X18 for F1760 (Note 1) DQS for X32/X36 for F1760 (Note 1) DQS for X4 for F1517 DQS for X8/X9 for F1517 (Note 1) DQS for X16/X18 for F1517 (Note 1) DQS for X32/X36 for F1517 (Note 1) DQS for X4 for H1152 DQS for X8/X9 for H1152 (Note 1) DQS for X16/X18 for H1152(Note 1) NC K34 H33 D32 TDI TDI L34 G34 G28 TMS TMS J35 F34 H28 TRST TRST H37 C37 J28 TCK TCK H36 D36 F30 TDO TDO J36 F35 G29 VCCA_PLL_L1 M34 L31 VCCD_PLL_L1 M33 M30 1A VREF1A PLL_L1_CLKn PLL_L1_CLKn C42 C39 1A VREF1A PLL_L1_CLKp PLL_L1_CLKp C41 C38 1A VREF1A IO PLL_L1_CLKOUT0n DIFFIO_TX_L1n DIFFOUT_L1n G38 J33 G31 1A VREF1A IO PLL_L1_FB_CLKOUT0p DIFFIO_TX_L1p DIFFOUT_L1p G37 K32 G30 1A VREF1A IO RDN1A DIFFIO_RX_L1n DIFFOUT_L2n C40 G35 E32 1A VREF1A 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VREF4C AP19 AN17 AH16 VREF4B VREF4B VREF4B AP15 AM16 AG13 VREF4A VREF4A VREF4A AP11 AM12 AG10 VREF5A VREF5A VREF5A AL8 AK9 AF7 VREF5B VREF5B VREF5B AG7 AE8 VREF5C VREF5C VREF5C AC7 AB8 AA9 VREF6C VREF6C VREF6C Y9 Y6 U8 VREF6B VREF6B VREF6B T9 T8 VREF6A VREF6A VREF6A K7 L10 P9 VREF7A VREF7A VREF7A H12 F10 H10 VREF7B VREF7B VREF7B J15 H16 H13 VREF7C VREF7C VREF7C J20 G20 G15 VREF8C VREF8C VREF8C J23 G23 G19 VREF8B VREF8B VREF8B J26 H24 H22 VREF8A VREF8A VREF8A J30 H28 H25 VCCPT L33 J32 J27 VCCPT AA33 Y33 U29 VCCPT AM34 AL32 AG27 VCCPT AM22 AL20 AJ17 VCCPT AN9 AL8 AG7 VCCPT AB11 Y7 V6 VCCPT K9 J8 H8 VCCPT L21 J20 F18 VCCPGM AN33 AJ31 AD24 VCCPGM AM10 AJ10 AD10 VCCBAT K8 K8 G6 NC AK16 AP35 AK30 NC AT38 AD27 AC10 NC AK19 T13 M25 NC AK20 N12 L11 NC AK21 N28 L25 NC AK23 L30 K26 NC AK24 NC AK27 NC AF13 NC AB13 NC AB30 NC AA13 NC V30 NC T13 NC P33 NC N16 NC N19 NC N20 NC N22 NC N23 NC N24 NC N27 NC N30 Note: "(1) When not used as clocks, the CQn and DQSn pins can be used as DQ pins."